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（2）原理图（Multisim和QuartusII中绘制的原理图）：
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六、实验过程中的问题
1.在用VHDL语言写了一些器件，在应用时候，没有将逻辑电路图放到顶层，导致没有找到目标管脚。在仔细查看老师所给的参考资料之后，将设置调整为“顶层文件采用原理图设计方法”，得到了正确的结果。
2.在进行波形仿真的时候，没有考虑到延迟。一开始在脉冲时间间隔很短的情况下，发现波形并没有沿边变化。查找相关资料，了解到时序仿真会有延迟。于是我们将脉冲时间间隔调大，最终得到了正确的结果。
七、心得体会
1. 通过本次实验，初步掌握了VHDL语言的使用。学会用VHDL语言实现指定逻辑电路，并对几个模块进行综合。实验过程中出现的问题主要是编写代码错误，编写代码过程中一个字符打错了可能是整个代码错误，因此必须格外认真。代码更要做到准确、简洁，学会找出错误，改正错误。
2.前三次的实验都是利用quartus自带的器件资源库完成一定的逻辑功能。而这次实验是第一次写VHDL，可以用代码描述想要实现的逻辑功能，然后将它们封装为一个器件来使用。正是这次实验，让我们体会到数字逻辑电路设计的精华所在。提高了我们对数字逻辑电路的设计的兴趣。
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